采样率变换器的多相表示结构FPGA实现
图11给出了一个D=3、I=4、N为12时的分数采样率变换的部分仿真结果(Modelsim 6.1)。其中，滤波器系数定点化为12位补码，输入、输出数据为12位补码整数, 测试输入序列为20kHz的正弦波波形序列，采样率为600kHz,输出为800kHz采样的正弦波序列。通过把输入输出序列保存并做FFT变换，可以得到两者的实际频率相同的结论。
利用FIR滤波器的多相分解及多采样率网络变换技术，本文介绍了一种有理数采样率变换器的高效多相结构，并结合FPGA芯片的结构进行了实现与优化。文中的一些方法也适用于其他多采速率系统的设计。
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